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将所有输入信号位的和、或或异或位减少为单位
编码/逻辑和位操作
的减少一些块对输入信号的所有位执行选定的位减运算(与、或或异或),以获得一个单位结果。
减少模式
指定还原操作:
和(默认):执行输入信号的位与减少。
和
或:输入信号按位或减少。
或
XOR:执行输入信号的逐位异或减少。
XOR
该块有以下端口:
金宝app支持的数据类型:定点、整数(有符号或无符号)、布尔值
最小位宽:2
最大位宽:128
金宝app支持数据类型:ufix1
ufix1
HDL Coder™提供了影响HDL实现和合成逻辑的额外配置选项。
这个块有一个单独的、默认的HDL架构。
通过在设计中移动现有延迟而放置在输出处的寄存器数。分布式管道不会重新分发这些寄存器。默认值是0.有关详细信息,请参见ConstrainedOutputPipeline.
0
要插入生成代码的输入管道阶段的数目。分布式管道和受约束的输出管道可以移动这些寄存器。默认值是0.有关详细信息,请参见InputPipeline.
要插入生成代码的输出管道阶段的数量。分布式管道和受约束的输出管道可以移动这些寄存器。默认值是0.有关详细信息,请参见OutputPipeline.
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